vhdl, verilog, chisel, bsv같은 hdl은
사실상 하드웨어 다이어그램 표현용 마크업 언어이지 않나??
근데 verilog 계열은 hdl을 컴파일해서 시뮬 돌리는걸 상정해서 만든것처럼 보이긴함
vhdl, verilog, chisel, bsv같은 hdl은
사실상 하드웨어 다이어그램 표현용 마크업 언어이지 않나??
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